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가변지연회로 및 이를 포함하는 지연고정루프 document_id 1020100020321

출원번호
1020100020321
분류
전기(H섹션)
문맥 (context)
[청구항 1] 제1지연부와 제2지연부를 포함하고 입력신호를 지연하여 출력신호를 생성하는 지연회로 상기 지연회로의 지연값을 검출해 상기 제1지연부와 상기 제2지연부 중 상기 입력신호를 지연시킬 지연부를 선택하는 선택신호를 생성하는 선택신호발생부 지연증감신호에 응답하여 상기 선택신호에 의해 선택된 지연부의 지연값을 제어하는 제1제어부; 및 상기 선택신호에 의해 선택되지 않은 지연부의 지연값을 제어하는 제2제어부 를 포함하는 가변지연회로 [청구항 2] 제 1항에 있어서,상기 입력신호는 클럭이며,상기 제2제어부는 상기 선택되지 않은 지연부의 지연값이 n*클럭(n은 2이상의 정수)-선택된 지연부의지연값제어하는것을특징으로 하는가변지연회로. [청구항 3] 제 2항에 있어서,상기 선택신호 발생부는상기 제1지연부와 상기 제2지연부의 지연값 차이가 m*클럭(m은 1이상의 정수)인 시점에서 선택되는 지연부를 변경하는선택신호발생시키는것을특징으로 하는가변지연회로. [청구항 4] 제 1항에 있어서,상기 제1제어부는상기 지연증감신호에 응답하여 제1충전/방전전류를 발생시키는제1전하펌프포함하는것을특징으로 하는가변지연회로. [청구항 5] 제 4항에 있어서,상기 제2제어부는상기 입력신호와 상기 입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호를 입력받아 상기 선택신호에 의해 선택되지 않은 지연부의 지연값을 제어하는 제어신호를 생성하는 총지연검출기; 및상기 제어신호에 응답하여 제2충전/방전전류를 발생시키는제2전하펌프포함하는것을특징으로 하는가변지연회로. [청구항 6] 제 5항에 있어서,상기 제1지연부는상기 제1충전/방전전류 또는 상기 제2충전/방전전류 중 하나를 선택하기 위한 제1선택부;상기 제1선택부의 출력에 응답하여 충방전되는 제1루프필터;상기 제1루프필터에 충전된 전압에 응답하여 자신에 입력된 신호를 지연해 출력하는제1전압제어지연라인포함하는것을특징으로 하는가변지연회로. [청구항 7] 제 6항에 있어서,상기 제2지연부는상기 제1충전/방전전류 또는 상기 제2충전/방전전류 중 하나를 선택하기 위한 제2선택부;상기 제2선택부의 출력에 응답하여 충방전되는 제2루프필터; 및상기 제2루프필터의 출력전압에 응답하여 자신에 입력된 신호를 지연해 출력하는제2전압제어지연라인포함하는것을특징으로 하는가변지연회로. [청구항 8] 제 5항에 있어서,상기 지연회로는상기 선택신호에 응답하여 상기 입력신호와 제2지연부의 출력신호 중 하나를 상기 제1지연부에 입력하기 위한 제3선택부;상기 선택신호에 응답하여 상기 제1지연부의 출력신호와 상기 입력신호 중 하나를 상기 제2지연부에 입력하기 위한 제4선택부; 및상기 선택신호에 응답하여 상기 제1지연부와 상기 제2지연부의 출력신호 중 하나를 가변지연회로의 출력신호로 선택하고, 나머지 하나의 신호를 상기 제2제어부로 전달하기 위한제5선택부더포함하는것을특징으로 하는가변지연회로. [청구항 9] 외부클럭을 지연시켜 내부클럭을 출력하는 가변지연부 상기 내부클럭을 지연시켜 피드백클럭을 생성하는 레플리카 지연부; 및 상기 피드백클럭과 상기 외부클럭의 위상을 비교해 지연증감신호를 생성하는 위상비교부를 포함하고, 상기 가변지연부는 제1지연부와 제2지연부를 포함하고 상기 외부클럭을 지연하여 상기 내부클럭을 생성하는 지연회로 상기 지연회로의 지연값을 검출해 상기 제1지연부와 상기 제2지연부 중 상기 외부클럭을 지연시킬 지연부를 선택하는 선택신호를 생성하는 선택신호발생부 상기 지연증감신호에 응답하여 상기 선택신호에 의해 선택된 지연부의 지연값을 제어하는 제1제어부; 및 상기 선택신호에 의해 선택되지 않은 지연부의 지연값을 제어하는 제2제어부 를 포함하는 것을 특징으로 하는 지연고정루프 [청구항 10] 제 9항에 있어서,상기 제2제어부는 상기 선택되지 않은 지연부의 지연값이 n*클럭(n은 2이상의 정수)-선택된 지연부의지연값제어하는것을특징으로 하는지연고정루프. [청구항 11] 제 10항에 있어서,상기 선택신호발생부는상기 제1지연부와 상기 제2지연부의 지연값 차이가 m*클럭(m은 1이상의 정수)인 시점에서 선택되는 지연부를 변경하는선택신호발생시키는것을특징으로 하는지연고정루프. [청구항 12] 제 11항에 있어서,상기 제1제어부는상기 지연증감신호에 응답하여 제1충전/방전전류를 발생시키는 제1전하펌프를 포함하고,상기 제2제어부는상기 입력신호와 상기 입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호를 입력받아 상기 선택신호에 의해 선택되지 않은 지연부의 지연값을 제어하는 제어신호를 생성하는 총지연검출기; 및상기 제어신호에 응답하여 제2충전/방전전류를 발생시키는제2전하펌프포함하는것을특징으로 하는지연고정루프. [청구항 13] 제 12항에 있어서,상기 제1지연부는상기 제1충전/방전전류 또는 상기 제2충전/방전전류 중 하나를 선택하기 위한 제1선택부;상기 제1선택부의 출력에 응답하여 충방전되는 제1루프필터;상기 제1루프필터에 충전된 전압에 응답하여 자신에 입력된 신호를 지연해 출력하는 제1전압제어지연라인을 포함하고,상기 제2지연부는상기 제1충전/방전전류 또는 상기 제2충전/방전전류 중 하나를 선택하기 위한 제2선택부;상기 제2선택부의 출력에 응답하여 충방전되는 제2루프필터; 및상기 제2루프필터의 출력전압에 응답하여 자신에 입력된 신호를 지연해 출력하는제2전압제어지연라인포함하는것을특징으로 하는지연고정루프. [청구항 14] 제 12항에 있어서,상기 지연회로는상기 선택신호에 응답하여 상기 입력신호와 제2지연부의 출력신호 중 하나를 상기 제1지연부에 입력하기 위한 제3선택부;상기 선택신호에 응답하여 상기 제1지연부의 출력신호와 상기 입력신호 중 하나를 상기 제2지연부에 입력하기 위한 제4선택부; 및상기 선택신호에 응답하여 상기 제1지연부와 상기 제2지연부의 출력신호 중 하나를 상기 가변지연부의 출력신호로 선택하고, 나머지 하나의 신호를 상기 제2제어부로 전달하기 위한제5선택부더포함하는것을특징으로 하는지연고정루프.
지시문 (instruction)
주어진 본문을 읽고 관련 정보를 분석하여 질문에 답하라.
질문 (question)
가변지연회로에서 선택신호에 의해 선택되지 않은 지연부의 지연값을 제어하는 제2제어부는, 입력신호와 어떤 신호를 입력받아 제어신호를 생성하는가?
추론 과정 (compact_reasoning)
  1. 1과제 해석task_interpretation

    제2제어부가 입력신호와 함께 어떤 신호를 입력받아 제어신호를 생성하는지 파악해야 한다.

  2. 2정보 추출information_extraction

    청구항 5를 통해 제2제어부의 구성 요소인 총지연검출기가 입력받는 신호 정보를 추출한다.

    • 상기 제2제어부는상기 입력신호와 상기 입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호를 입력받아
  3. 3근거 선택evidence_selection

    제2제어부가 입력받는 두 가지 신호인 '입력신호'와 '입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호'를 선택한다.

    • 상기 입력신호와 상기 입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호
  4. 4논리 통합logical_integration

    질문에서 요구하는 '입력신호와 어떤 신호'에 해당하는 부분을 문맥에서 결합한다.

    • 상기 입력신호와 상기 입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호
  5. 5결론 도출conclusion_formulation

    제2제어부는 입력신호와 입력신호가 제1지연부 및 제2지연부를 모두 통과한 신호를 입력받아 제어신호를 생성함을 도출한다.

    • 상기 입력신호와 상기 입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호를 입력받아 상기 선택신호에 의해 선택되지 않은 지연부의 지연값을 제어하는 제어신호를 생성하는 총지연검출기
  6. 6답변 생성answer_generation

    추출된 정보를 바탕으로 질문에 대한 직접적인 답변을 작성한다.

    • 상기 입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호
최종 답변 (final_answer)
상기 입력신호가 상기 제1지연부와 상기 제2지연부를 모두 통과한 신호
핵심 해석 (core_interpretation)
가변지연회로에서 선택되지 않은 지연부의 지연값을 제어하기 위해, 입력신호와 해당 신호가 모든 지연부를 통과한 신호를 이용해 총지연을 검출하는 기술에 관한 것이다.